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Titlebook: Rechnergestützter Entwurf und Architektur mikroelektronischer Systeme; GME/GI/ITG-Fachtagun Bernd Reusch Conference proceedings 1990 Spring

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樓主: Sediment
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發(fā)表于 2025-3-26 21:37:58 | 只看該作者
Rechnergestützte Spezifikation in einer integrierten Entwurfsumgebung für anwendungsspezifische Systigitaler Systemkomponenten, das im Rahmen eines Projektes zur Entwicklung einer integrierten, spezifikationsgesteuerten Entwurfsumgebung für Mikrosysteme (DEBYS — DEsign BY Specification) an der Universit?t Erlangen-Nürnberg entwickelt wird. Aufgabe des Systems ist es, die Entwicklung von detaillier
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發(fā)表于 2025-3-27 03:19:54 | 只看該作者
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發(fā)表于 2025-3-27 07:01:35 | 只看該作者
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發(fā)表于 2025-3-27 13:27:22 | 只看該作者
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發(fā)表于 2025-3-27 14:22:06 | 只看該作者
Architekturentwurf für nebenl?ufige, funktionssichere Steuerungen vor allem bei Auf-gabenstellungen, die eine Aufteilung der Steuerung auf mehrere, miteinander kooperie-rende Teilsteuerwerke erfordern. In diesem Beitrag konzentrieren wir uns auf Fragen der Spezifikation, der Verifikation und der Realisierung solcher Steuerungen. Wir stellen ein integriertes Entwu
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發(fā)表于 2025-3-27 18:33:49 | 只看該作者
CASCH — ein Scheduling-Algorithmus für ?High-Level“-Synthesee. Der Algorithmus wird als Teil des CADDY-Synthese-Systems eingesetzt (CAddy SCHeduling). Als Basis wird ein Listen-Scheduling-Algorithmus verwendet, der durch eine heuristische Bewertungsfunktion gesteuert wird. Der Algorithmus verfolgt die Strategie, ausgehend von gegebenen Ressourcen die Gesamtv
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發(fā)表于 2025-3-27 23:11:46 | 只看該作者
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發(fā)表于 2025-3-28 04:00:34 | 只看該作者
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發(fā)表于 2025-3-28 09:46:41 | 只看該作者
Testbarkeitsanalyse beim hierarchischen top-down Entwurfsetzbar, wenn der Entwurf einer Schaltung praktisch abgeschlossen ist. Werden Testbarkeitsm?ngel einer Schaltung erst zu diesem Zeitpunkt erkannt, so führt dies zu aufwendigen und kostenintensiven Redesigns. Um diese Probleme zu vermeiden, wird hier ein Testbarkeitsma? vorgestellt, das prinzipiell a
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發(fā)表于 2025-3-28 10:39:59 | 只看該作者
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